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本申请涉及使用分解的分量数字的浮点乘法硬件。一种处理器系统包括一个或更多个逻辑单元，该逻辑单元被配置为接收识别将与第二浮点数相乘的第一浮点数的处理器指令。浮点数各自被分解成一组多个分量数字，其中用于表示每个浮点数的位数大于用于表示每组多个分量数字中的任何分量数字的位数。第一组的分量数字与第二组的分量数字相乘以确定中间乘法结果，将这些中间乘法结果相加在一起以确定表示第一浮点数与第二浮点数相乘的结果的有效结果。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112596697 A
(43)申请公布日 2021.04.02
(21)申请号 202011073214.3 (51)Int.Cl.
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