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2023-06-07 发布于四川
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一种数字通讯总线电平检测电路.pdf

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本发明提供一种数字通讯总线电平检测电路，其包括：外部端口；内部串行时钟引脚；内部串行数据引脚；第一上拉电阻，其连接于内部串行时钟引脚和外部端口之间；第二上拉电阻，其连接于内部串行数据引脚和外部端口之间；电平检测器，其用于检测内部串行时钟引脚或内部串行数据引脚的高电平，并将检测到的该高电平作为参考高电平；波形整形电路，其以参考高电平作为逻辑高电平，对外部串行数据信号进行整形以得到外部串行数据信号，对外部串行时钟信号进行整形以得到外部串行时钟信号。与现有技术相比，本发明可以在内外部间形成正确的通讯交

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 112798852 A (43)申请公布日 2021.05.14 (21)申请号 202110145178.5 (22)申请日 2021.02.02 (71)申请人美新半导体（天津）有限公司

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