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本发明实施例提供了一种并行乘法器及其工作方法，其中，该并行乘法器包括：编码解码电路，用于对NR4SD+的数字集进行编码和解码处理，得到部分积阵列；约简树结构，连接所述编码解码电路，用于对所述部分积阵列中除最后两个部分积行之外的部分进行累加处理；改进后的平方根选择进位加法器，连接所述约简树结构，用于对所述部分积阵列的最后两个部分积行进行加法处理，其中，改进后的平方根选择进位加法器包括全加器、半加器和第一定制组合电路，所述第一定制组合电路包括数字电路器件。该方案可以提高时序，同时，减小了面积，有利于
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 112860219 B
(45)授权公告日 2022.09.09
(21)申请号 202110217611.1 审查员 张骞
(22)申请日 2021.02.26
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