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将时钟结构用于组织成多个时钟区域的FPGA的方法和装置.pdfVIP

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  • 2023-06-17 发布于四川
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将时钟结构用于组织成多个时钟区域的FPGA的方法和装置.pdf

    本申请涉及将时钟结构用于组织成多个时钟区域的FPGA的方法和装置。FPGA包含一个可配置半导体，该可配置半导体组织成多个时钟区域，其时钟结构用于实现用户定义的逻辑功能。该时钟结构提供一组区域时钟信号，该时钟信号由高质量时钟源产生，用于驱动时钟区域中的逻辑块。另外，一组相邻时钟信号或区域间时钟信号由相邻时钟源产生，用于对两个相邻区域的逻辑块进行时钟驱动。此外，时钟结构提供次级时钟信号，该次级时钟信号由区域时钟信号产生且具有低时钟信号质量，用于以时间敏感度较低的逻辑操作对逻辑块进行时钟驱动。

    (19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 113270125 A (43)申请公布日 2021.08.17 (21)申请号 202110637974.0 (22)申请日 2021.06.08 (30)优先权数据

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