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本公开提供沟道的接触电阻低的半导体存储装置及其制造方法。实施方式的半导体存储装置具备多个第1布线层、第1柱、第2布线层、半导体含有层以及第1绝缘层。多个第1布线层在第1方向上层叠。第1柱在多个第1布线层的内部沿着第1方向延伸,且包含第1半导体层。第2布线层配置在第1半导体层的上端的上方,沿着与第1方向交叉的第2方向延伸。半导体含有层具有第1部分、第2部分以及第3部分。第1部分配置在第1半导体层的上端与第2布线层的底面之间。第2部分与第1部分相接,沿着第2布线层的侧面设置。第3部分与第2部分的上端
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114188344 A
(43)申请公布日 2022.03.15
(21)申请号 202110606127.8 H01L 27/11529 (2017.01)
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