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本发明公开了一种码率兼容的低码率QC‑LDPC码构造方法及装置，其中，方法包括：依据所需码率与码长，构造行列重分布联合优化的融合模板矩阵，通过逐次信息位与校验位截短得到嵌套的各码率模板矩阵；根据融合模板矩阵与各码率模板矩阵的嵌套关系，对融合模板矩阵不同部分的偏移地址进行渐进设计，得到构造的融合偏移地址矩阵；通过融合偏移地址矩阵的提升，得到构造的融合校验矩阵和嵌套的各码率校验矩阵。本发明的方法能够在兼容多种码率的基础上保持各个码率的优良性能，并有效降低编码调制系统的设计复杂度与硬件实现复杂度，有效
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113691262 A
(43)申请公布日 2021.11.23
(21)申请号 202110843414.0
(22)申请日 2021.07.26
(71)申请人 清华大学
地址 10
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