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本发明提供一种一种MIMO模块硬件结构优化方法，增加内置校正源，校正源采用锁相环PLL，将压控振荡器VCO输出频率分频，将其与一个参考信号进行比较，然后微调VCO控制电压以微调其输出频率；校正源信号接入衰减器；衰减器输出的信号通过功分器开关进入接收通道；所述接收通道前设置SPDT开关，步骤S3的信号通过SPDT开关实现校正源信号至接收通道和频率源至射频输入连接器的硬件通路，接收通道选通射频输入连接器或校正源信号。本发明本发明在模块内部增加校正频率源与开关组，在实现增加校正源目的的同时，降低功耗的
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 113708782 B
(45)授权公告日 2023.03.28
(21)申请号 202110993287.2 H04B 7/0413 (2017.01)
(22)申请日 2021.0
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