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本发明涉及串联模块快速通讯的方法,包括以下步骤:初始状态下,参与串联的模块上的两个数据端口默认为输入状态;控制器的两个数据端口分别从串联的模块组两端同时发送数据组,两组数据组其一的多个数据包顺序排列,另一的多个数据包倒序排列,模块的一个数据端口接收到数据包时,进行数据有效检测,有效检测通过后,对接收到的第一组数据包进行数据采样存储以及切换模块的另一数据端口为输出状态的操作,再通过切换为输出状态后的数据端口对后续接收到的数据包进行数据整形转发;在进行通讯时,可以从串联的模块组的两端同时进行数据的发
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113746752 A
(43)申请公布日 2021.12.03
(21)申请号 202111310717.2
(22)申请日 2021.11.08
(71)申请人 深圳合芯谷微电子有限公司
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