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- 2023-07-05 发布于四川
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本发明公开了一种基于忆阻器的平衡三值译码器电路，包括第一输出电路、第二输出电路、第三输出电路。所述第一输出电路由第一忆阻器M1和第一NMOS管T1所构成；所述第二输出电路由第二忆阻器M2、第三忆阻器M3、第二NMOS管T2、第三NMOS管T3所构成；所述第三输出电路由第四忆阻器M4、第五忆阻器M5、第四NMOS管T4、第五NMOS管T5所构成，形成了一个输入端和三个输出端的电路结构。本发明电路模型结构清晰简单、易于实现，对多值数字逻辑电路设计等诸多领域中的应用研究具有重要意义。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113810043 A
(43)申请公布日 2021.12.17
(21)申请号 202111031598.7
(22)申请日 2021.09.03
(71)申请人 杭州电子科技大学
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