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本发明提供了一种加速处理装置,包括:主控设备和多个处理器;至少部分处理器为FPGA;处理器包括处理模块,且至少部分处理器所包括的处理模块不同;主控设备用于确定需要调用的目标处理模块以及调用顺序;当前处理模块用于:在接收到当前处理信号的情况下,获取当前待处理数据,对当前待处理数据进行处理,将相应的处理结果作为下一待处理数据;将下一待处理数据发送至下一处理模块,并向下一处理模块发送下一处理信号。通过本发明实施例提供的加速处理装置,处理模块可以独自完成处理,每个处理模块也均是独立的,不同的目标处理模块
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116431211 A
(43)申请公布日 2023.07.14
(21)申请号 202310404568.9 G06T 1/20 (2006.01)
(22)申请日 2023.04.1
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