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多路并联锁存器、运算单元以及芯片.pdfVIP

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  • 2023-07-18 发布于四川
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多路并联锁存器、运算单元以及芯片.pdf

    本实用新型实施例提供了一种多路并联锁存器、运算单元以及芯片，多路并联锁存器包括：多个输入端；一个时钟信号端，用于提供时钟信号；多个锁存器，每个锁存器与一个输入端连接，用于在时钟信号的控制下锁存并传输从与该锁存器连接的输入端输入的数据；多个输出端；其中，锁存器包括：锁存单元、输出单元以及保持电容；锁存单元与输入端连接；输出单元与锁存单元连接；输出单元与锁存单元之间具有一数据存储节点；保持电容与数据存储节点连接，当锁存单元在时钟信号的控制下处于高阻状态时，保持电容用于存储数据存储节点处的数据。本实用

    (19)中华人民共和国国家知识产权局 (12)实用新型专利 (10)授权公告号 CN 214228229 U (45)授权公告日 2021.09.17 (21)申请号 202120168431.4 (22)申请日 2021.01.21 (73)专利权人 北京源启先进微电子有限公司

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