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本发明请求保护一种用于SAR型ADC的辅助解码DAC结构,包括采样电路模块、第一级DAC电容阵列、第二级DAC电容阵列、比较器阵列模块、就绪时钟信号模块、数字逻辑控制模块、异步时钟模块以及寄存器模块。第一级DAC电容阵列通过环路展开结构先对输入模拟信号解码,具有复用结构的比较器产生比较结果寄存在寄存器中,并作用在第二级DAC电容阵列上。第二级DAC电容阵列采用桥接电容结构,其MSB段电容经第一级DAC电容阵列量化,进行电容开关切换。独立比较器开始LSB段的量化,两个DAC电容阵列生成的输出码存储
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116743176 A
(43)申请公布日 2023.09.12
(21)申请号 202310746093.1
(22)申请日 2023.06.21
(71)申请人 重庆邮电大学
地址 400065
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