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本发明涉及一种可重构DW卷积和普通卷积的FPGA实现方法及其加速器，属于计算机领域。该方法包括以下步骤：对FPGA部署卷积神经网络模型时，进行输入特征图的数据重排和权重数据重排；采用数据切片重排，一次将一个切片中的数据存储到FPGA的片上存储中。本发明的方法旨在通过ARM上权重排序程序的简单修改即可完成DW卷积和普通卷积在FPGA上的融合，且不需要再对FPGA上部署的加速器做更多的修改。即在不额外增加任何FPGA硬件资源的情况下，将DW卷积融合到针对普通卷积设计的加速器中。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116775558 A
(43)申请公布日 2023.09.19
(21)申请号 202310963503.8
(22)申请日 2023.08.02
(71)申请人 重庆邮电大学
地址 400065
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