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公开了一种包括可重写非易失性存储器和CMOS接口的外部非易失性存储器设备。接口包括输入到外部非易失性存储器设备的时钟信号。该时钟信号乘以整数以创建用于对传出数据进行计时的存储器serdes时钟。存储器serdes时钟还用于创建用于对来自主处理设备的传入数据进行计时的时钟。外部非易失性存储器设备还包括加密/解密块，加密/解密块在通过接口传输数据之前对从非易失性存储器读取的数据进行加密，以及在将数据存储在非易失性存储器之前对从接口接收的数据进行解密。加密/解密块可利用流密码。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116796339 A
(43)申请公布日 2023.09.22
(21)申请号 202310175977.6 G06F 21/78 (2013.01)
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