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本发明实施例提供的一种FPGA配置码流的读回校验方法及装置，所述方法包括，在同一个移位过程内，利用配置控制器执行写操作、读操作，通过移位寄存器将配置码流中的一行二进制数据输入到FPGA内核的配置存储器后，立即读出配置存储器中的数据，利用校验模块对比输入和读出的一行二进制数据进行校验，直至完成所述FPGA配置码流的读回校验。在本发明实施例中，缩短了FPGA读回校验方法校验数据的时长，提升了FPGA码流配置效率，并节省了内部存储空间，降低了FPGA的实施成本。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116795583 A
(43)申请公布日 2023.09.22
(21)申请号 202310814428.9
(22)申请日 2023.07.04
(71)申请人 京微齐力（北京）科技股份有限公司
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