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本发明提供一种基于高级语言模拟RTL的建模方法与装置，通过定义时钟与周期，将组合逻辑相关信号和时序逻辑相关信号分别抽象成组合事务和时序事务，并将所有所述组合事务和时序事务放入相应的队列，将时钟、时序事务和组合事务分开考虑，时钟负责维护事务队列，时序逻辑和组合逻辑的运行均由事务驱动，在每个周期中将组合事务和时序事务分开进行信号的传输，并进行相应的赋值与更新，实现逻辑功能的接收与发送，通过维护事务队列，实现组合事务和时序事务按照周期的正确执行。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116882336 A
(43)申请公布日 2023.10.13
(21)申请号 202311149789.2
(22)申请日 2023.09.07
(71)申请人 芯动微电子科技（珠海）有限公司
地
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