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本发明公开了一种读控制电路包括:灵敏放大器,多个锁存器,数据判断器。灵敏放大器的输出端同时连接到各锁存器的输入端。各锁存器的控制端分别连接一个全局时钟信号。各锁存器的输出端分别连接到数据判断器的一个输入端。在读取阶段中:灵敏放大器的输出端输出读取放大电压。各锁存器在所连接的全局时钟信号有效时进入取样输出阶段且在取样输出阶段形成一位由读取放大电压确定的第一读取数字信号。各锁存器的取样输出阶段依次错开。数据判断器对各第一读取数字信号进行逻辑运算得到第二读取数字信号,逻辑运算实现第二读取数字信号取各第
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116884462 A
(43)申请公布日 2023.10.13
(21)申请号 202310695146.1
(22)申请日 2023.06.13
(71)申请人 上海华虹宏力半导体制造有限公司
地
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