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本发明公开了一种用于锁相环电路中的参考时钟检测电路，包括计数器子电路、第一逻辑控制子电路、第二逻辑控制子电路以及采样子电路；第一逻辑控制子电路接收参考时钟和锁相环使能信号，输出计数复位信号至计数器子电路；计数器子电路接收反馈时钟信号并对反馈时钟信号进行计数；第二逻辑控制子电路接收反馈时钟信号、计数器子电路输出的计数信号、锁相环使能信号以及采样子电路输出的指示信号；采样子电路接收采样复位信号和采样时钟信号并输出指示信号至后续电路、以使后续电路接收到参考时钟正常工作/未正常工作的指示，同时将该指示信
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 117040497 A
(43)申请公布日 2023.11.10
(21)申请号 202310816603.8
(22)申请日 2023.07.05
(71)申请人 成都锐成芯微科技股份有限公司
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