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一种存储器包括：DC转换电路，被配置为接收具有第一脉冲的第一边沿触发相位信号、以及具有第二脉冲的第二边沿触发相位信号，每个第一脉冲从多相时钟的第一相位信号的上升沿延伸到多相时钟的第二相位信号的稍后的上升沿，每个第二脉冲从第二相位信号的上升沿延伸到第一相位信号的稍后的上升沿，并且输出与第一边沿触发相位信号相对应的第一电压和与第二边沿触发相位信号相对应的第二电压；比较器，被配置为将第一电压与第二电压进行比较；控制逻辑，被配置为生成与来自比较器的输出值相对应的控制码；以及延迟单元，被配置为根据控制码来
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 117037868 A
(43)申请公布日 2023.11.10
(21)申请号 202310518496.0
(22)申请日 2023.05.09
(30)优先权数据
10-2022-0057058
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