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2024-01-20 发布于四川
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一种基于RISC-V架构的处理器验证系统.pdf

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本发明公开了一种基于RISC‑V架构的处理器验证系统，将指令生成模块、程序编译模块、模拟器模块、仿真验证模块、比对检查模块和回归管理模块联系起来，通过统一的接口和交互提高验证环境的整体效率、自动化程度和可靠性；对开源指令生成器进行改造设计出适应不同功能场景的指令生成模块，确保生成的随机指令流覆盖各种场景和特殊情况；对被测对象和子系统的行为级功能进行模拟，实现全面准确的验证；利用RTL仿真日志文件与模拟器输出日志文件进行比对的方式减少验证系统对参考模型的依赖；通过并行回归多个用例、充分利用硬件资源

(19)国家知识产权局

(12)发明专利申请

(10)申请公布号CN117422026A

(43)申请公布日2024.01.19

(21)申请号202311733460.0

(22)申请日2023.12.18

(71)申请人青岛本原微电子有限公司

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