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本申请提供一种基于Formal工具的仿真验证激励生成方法、装置、介质及终端，包括：利用Formal工具对属性数据进行覆盖验证；若验证结果为属性数据能被覆盖，则基于属性数据被覆盖的事件发生时所对应的目标输入信号值生成输入接口信号时序数据；基于UVM环境采集所述输入接口信号时序数据，以还原生成属性数据对应的输入接口信号激励序列；将输入接口信号激励序列进行封装以获取输入接口信号激励序列库，以供在UVM测试用例中进行仿真调用；基于UVM环境对输入接口信号激励序列库和属性数据进行验证测试，以确定所述UVM
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117435483A
(43)申请公布日2024.01.23
(21)申请号202311378815.9
(22)申请日2023.10.23
(71)申请人合芯科技有限公司
地址5100
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