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公开了一种时钟多路复用电路、脉冲发生器和存储器装置。时钟多路复用电路包括第一晶体管和第二晶体管，第一晶体管在接收第一输入时钟信号的第一输入端子和输出输出脉冲信号的输出端子之间，并且基于接收第二输入时钟信号的第二输入端子的逻辑电平而操作，第二晶体管在输出端子和第一电压节点之间，并且基于第二输入端子的逻辑电平而操作。第一输入时钟信号和第二输入时钟信号具有相同的周期和不同的相位。输出脉冲信号在第一输入时钟信号转变到第一逻辑电平时的第一时间处转变到第一逻辑电平，并且在第二输入时钟信号转变到第一逻辑电平时
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117437945A
(43)申请公布日2024.01.23
(21)申请号202310822112.4
(22)申请日2023.07.06
(30)优先权数据
10-2022-0091304
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