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本发明属于数模混合集成电路技术领域,具体为一种适用于异步比较器的亚稳态检测电路。本发明将每次动态比较器比较完成时间和设计分配的标准比较时间进行比较,当动态比较器比较完成时间小于设计分配的标准比较时间时,认为异步比较器没有进入亚稳态;当动态比较器比较完成时间大于设计分配的标准比较时间时,认为异步比较器进入亚稳态,并输出标志信号进而指导下一次的采样和以后的量化。本发明未采用时序逻辑电路,能够检测异步比较器是否出现亚稳态,并输出亚稳态标志位,避免异步逻辑出现长时间无结果输出,量化错误;能够及时检测亚稳
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117526942A
(43)申请公布日2024.02.06
(21)申请号202311541798.6
(22)申请日2023.11.16
(71)申请人电子科技大学
地址611731
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