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本发明公开了一种低抖动低偏斜时钟驱动电路及版图布局，该时钟驱动电路包括：输入放大模块，用于对接收到的两组输入时钟信号分别进行恢复放大处理，输出第一组放大时钟信号和第二组放大时钟信号；通道选择模块，用于根据接收到的通道控制信号INSEL，选择接收第一组放大时钟信号或第二组放大时钟信号，并根据所选择接收的一组放大时钟信号，输出一组差分电平信号；输出驱动模块，用于将一组差分电平信号转换成2N路LVPECL电平输出，以提高时钟驱动带载能力；带隙基准模块，用于为输入放大模块、通道选择模块和输出驱动模块提供
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117709281A
(43)申请公布日2024.03.15
(21)申请号202311726723.5
(22)申请日2023.12.14
(71)申请人北京时代民芯科技
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