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用于DEM匹配技术的无交叠四分频时钟电路及提供时钟信号的方法.pdfVIP

用于DEM匹配技术的无交叠四分频时钟电路及提供时钟信号的方法.pdf

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    本发明提供用于DEM匹配技术的无交叠四分频时钟电路及提供时钟信号的方法，涉及四分频时钟电路技术领域，包括第一组合逻辑模块、第二组合逻辑模块、第三组合逻辑模块、第四组合逻辑模块和反馈逻辑模块。本发明通过D触发器与逻辑门电路实现四相时钟无交叠，摒弃延时模块，电路结构简单，占用面积更小，有利于芯片集成化发展，且电路稳定性好，电路性能受PVT变化影响较小，在此基础上，只需要在电路后端添加多级组合逻辑模块，并增加反馈逻辑模块中或非门的输入端口，便能够根据实际需求产生多相无交叠时钟，方便对电路进行优化改造，

    (19)国家知识产权局

    (12)发明专利申请

    (10)申请公布号CN117792350A

    (43)申请公布日2024.03.29

    (21)申请号202311859303.4

    (22)申请日2023.12.30

    (71)申请人博越微电子（江苏）有限公司

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