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本发明提供一种支持任意尺寸与形状卷积核计算的架构，包括用于获取、预存和拼接输入像素数据，以及获取权重数据和层参数的输入数据准备部分，所述权重数据可能涉及将卷积核离线分割或拆分成若干子核；用于对输入数据准备部分获取的像素数据进行灵活排列的Z字形数据流数据准备部分，其中横向数据移动模块与纵向数据移动模块互相解耦，使架构具有支持任意尺寸与形状卷积核计算的灵活性，而不会产生冗余的计算和数据传输；用于根据层参数将目标像素数据与目标权重数据在乘累加阵列中进行卷积的计算部分；用于对输出像素进行排列和存储的输出
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117808050A
(43)申请公布日2024.04.02
(21)申请号202410036818.2
(22)申请日2024.01.10
(71)申请人南京大学
地址210023
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