基于ARM多核异构CPU的安全自检方法、设备及介质.pdfVIP

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2024-04-13 发布于四川
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基于ARM多核异构CPU的安全自检方法、设备及介质.pdf

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本发明涉及一种基于ARM多核异构CPU的安全自检方法、设备及介质，该方法包括以下步骤：步骤S1，对多核异构按照大小核指令集进行划分；步骤S2，上电，并进行大小核上电检测，若检测不通过，则进入步骤S3，否则，进入运行状态并执行步骤S4；步骤S3，保存错误码，内核进入死循环，结束；步骤S4，分别进行大小核在线检测，若检测不通过，则进入步骤S5，否则，进入步骤S6；步骤S5，保存错误码，内核进入宕机过程，结束；步骤S6，检测通过，结束。与现有技术相比，本发明具有灵活采用不同的内核检测方法、充分发挥芯片

(19)国家知识产权局

(12)发明专利申请

(10)申请公布号CN117873796A

(43)申请公布日2024.04.12

(21)申请号202311774274.1

(22)申请日2023.12.21

(71)申请人北京国家新能源汽车技术创新中心

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