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本发明公开了一种基于可编程逻辑门电路实现多处理器核间通信的系统及方法，该系统包括处理器、可编程逻辑门电路和DDR颗粒；该方法包括FPGA上电后对存储介质进行初始化、核间通信源核查询FPGA中对应状态存储块的值、核间通信源核向FPGA中对应数据存储块写入通信数据、核间通信目的核查询FPGA中对应状态存储块的值、核间通信目的核读取FPGA中对应数据存储块的通信数据。本发明的整个通信过程主要基于可编程逻辑门阵列电路，所有功能模块为硬件逻辑模块，有效改善处理器核间通信实时性和稳定性。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117909283A
(43)申请公布日2024.04.19
(21)申请号202410073407.0
(22)申请日2024.01.18
(71)申请人中船凌久电子(武汉)有限责任公司
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