XilinxFPGA的配置设计课件.pptVIP

Xilinx的FPGA下載配置電路設計6.1.1XilinxFPGA的下載配置模式針對不同的器件類型和應用場合，Xilinx公司為其FPGA系列產品提供了多種下載配置模式，如下所示：1.JTAG模式JTAG模式是基於IEEE1149.1和IEEE1532的下載配置模式，通過TDI（數據輸入）、TDO（數據輸出）、TMS（測試模式）和TCK（測試時鐘）等四根信號線實現FPGA的下載與配置。在JATG模式中需要其他可編程微控制器的支持。2.Parallel模式Parallel模式僅支持Virtex系列和SpartanⅡ系列器件，通過8bit的並行數據下載，實現FPGA的高速配置。Parallel模式的配置時鐘CCLK由FPGA外部提供。3.MasterSerial模式MasterSerial模式支持Xilinx公司的所有FPGA產品。MasterSerial模式通過讀取串行PROM的數據，實現FPGA的線上配置。在MasterSerial模式中必須使用Xilinx公司專用的PROM。MasterSerial模式的配置時鐘CCLK源於FPGA內部。4.SlaveSerial模式SlaveSerial模式支持Xilinx公司的所有FPGA產品。SlaveSerial模式類似於MasterSerial模式，但其配置時鐘CCLK由FPGA外部提供。在SlaveSerial模式中需要其他可編程微控制器支持。5.MasterSelectMAP模式MasterSerialMAP模式支持Virtex-Ⅱ等FPGA產品。MasterSerialMAP模式通過讀取串行PROM的數據，實現FPGA的線上配置。在MasterSelectMAP模式中必須使用Xilinx公司專用的PROM。MasterSerialMAP模式的配置時鐘CCLK源於FPGA內部。6.SlaveSelectMAP模式SlaveSelectMAP模式支持Virtex-Ⅱ等FPGA產品。SlaveSelectMAP模式類似於MasterSerialMAP模式，但其配置時鐘CCLK由FPGA外部提供。在SlaveSelectMAP模式中需要其他可編程微控制器的支持。6.1.1XilinxFPGA的下載配置模式Xilinx公司提供兩種PROM對其FPGA系列產品進行線上配置。其中，XC1800系列PROM可多次擦寫，支持JTAG線上編程。XC1700系列PROM為一次性編程器件，不支持JTAG線上編程。使用第三方編程器對Xilinx公司的PROM系列產品進行下載配置時，需要對FPGA設計檔進行格式轉換。在同一個FPGA的下載配置電路中，為了滿足不同應用要求，可以通過改變FPGA的M2、M1和M0管腳連接，實現FPGA下載配置模式的切換，即利用同一下載配置電路可以實現多種下載配置模式。在實際應用中，使用嵌入式下載配置方式，可以節約成本和簡化PCB板設計。嵌入式下載配置利用微處理器或其他可編程控制器件，對FPGA產品進行下載配置。在嵌入式下載配置過程中，M2、M1、M0引腳端應設置為JTAG、SlaveSerial或SlaveSelectMAP模式，下載配置的數據可以存放在Xilinx公司專用PROM或其他記憶體件中。當M2、M1、M0設置為SlaveSerial模式時，通過控制PROG＿B引腳端，可以實現FPGA的重新配置。當M2、M1、M0設置為SlaveSelectMAP模式時，通過控制PROG＿B、RDWR＿B和CS＿B引腳端，可以實現FPGA的重新配置和部分配置。6.1.2Virtex-Ⅱ系列器件下載配置電路設計Xilinx公司不同類型的FPGA器件下載配置模式不完全相同，下麵以Virtex-Ⅱ系列器件為例說明Xilinx公司的FPGA的下載配置設計過程。Virtex-Ⅱ系列器件的下載配置流程Virtex-Ⅱ系列器件的下載配置流程如圖6.1.1所示，主要包括：（1）PowerUp（加電）PowerUp是Virtex-Ⅱ系列器件的加電過程。其中，內核電壓VCCINT＝1.5V，I／OBank4的VCCO和VCCAUX的供電電壓應大於1.5V。（2）ClearConfigurationMemory（清配置記憶體）清配置記憶體的觸發條件是將PROG＿B引腳端置低，並保持低電平大於300ns。FPGA的所有與配置無關的引腳端將保持3態，INIT-B和DONE引腳端為低電平。（3）初始化將INIT-B引腳端置為高電平，採樣模式控制引腳端（Samp