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MIPS单总线CPU数据通路谭志虎
单总线结构CPU实例时序部件PCPCinPCout内总线操作控制信号…RinRoutR#W#Rs/RtRegDstRegs0101rsrdrtID操作控制器状态中断数据流控制流运算标志+4ALUZABADDXinZoutSUB状态PSWinPSWX主要部件都连接在总线上各部件间通过总线进行传输MEMARDRWriteReadARinDRinDRoutDREoutDREinIR(A)outIRinIRIR(I)outPCinPCoutRinRoutRs/RtRegDst+4ADDXinZoutSUBPSWinWriteReadARinDRinDRoutDREoutDREinIR(A)outIRinIR(I)out控制信号作用说明IRout、PCout、…Rout控制三态门将寄存器值输出到总线控制信号作用说明IRout、PCout、…Rout控制三态门将寄存器值输出到总线IRin、PCin、…Rin控制寄存器使能端将总线数据锁存(时钟驱动)控制信号作用说明IRout、PCout、…Rout控制三态门将寄存器值输出到总线IRin、PCin、…Rin控制寄存器使能端将总线数据锁存(时钟驱动)+4、ADD、SUB运算控制信号控制信号作用说明IRout、PCout、…Rout控制三态门将寄存器值输出到总线IRin、PCin、…Rin控制寄存器使能端将总线数据锁存(时钟驱动)+4、ADD、SUB运算控制信号Write、Read内存读写控制信号(时钟驱动)
单总线结构CPUMIPS指令周期时序部件PCPCinPCout内总线操作控制信号…RinRoutR#W#Rs/RtRegDstRegs0101rsrdrtID操作控制器状态中断运算标志+4ALUZABADDXinZoutSUB状态PSWinPSWXlwrt,imm(rs)swrt,imm(rs)beqrs,rt,immaddrd,rs,rtaddirt,rs,immMEMARDRWriteReadARinDRinDRoutDREoutDREinIR(A)outIRinIRIR(I)out数据流控制流
节拍数据通路(数据流)控制信号(控制流)T1PC?AR,PC?XPCout,ARin,Xin节拍数据通路(数据流)控制信号(控制流)T1PC?AR,PC?XPCout,ARin,XinT2X+4?Z+4节拍数据通路(数据流)控制信号(控制流)T1PC?AR,PC?XPCout,ARin,XinT2X+4?Z+4T3Z?PC,M[AR]?DRZout,PCin,DREin,Read节拍数据通路(数据流)控制信号(控制流)T1PC?AR,PC?XPCout,ARin,XinT2X+4?Z+4T3Z?PC,M[AR]?DRZout,PCin,DREin,ReadT4DR?IRDRout,IRin时序部件PCPCinPCout内总线操作控制信号…RinRoutR#W#Rs/RtRegDstRegs0101rsrdrtID操作控制器状态中断数据流控制流运算标志+4ALUZABADDXinZoutSUB状态PSWinPSWXMEMARDRWriteReadARinDRinDRoutDREoutDREinIR(A)outIRinIRIR(I)out取指令数据通路M[PC++]?IRPCPCoutARinXinARX+4ALUABPCinMEMDRReadDREinZoutZPCIRIRinDRout
节拍数据通路(数据流)控制信号(控制流)T5R[rs]?XRout,Xin节拍数据通路(数据流)控制信号(控制流)T5R[rs]?XRout,XinT6IR[I]+X?ZIR(I)out,ADD节拍数据通路(数据流)控制信号(控制流)T5R[rs]?XRout,XinT6IR[I]+X?ZIR(I)out,ADDT7Z?ARZout,ARin节拍数据通路(数据流)控制信号(控制流)T5R[rs]?XRout,XinT6IR[I]+X?ZIR(I)out,ADDT7Z?ARZout,ARinT8M[AR]?DRDREin,Read节拍数据通路(数据流)控制信号(控制流)T5R[rs]?XRout,XinT6X+imm?ZIR(I)out,ADDT7Z?ARZout,ARinT8M[AR]?DRDREin,ReadT9DR?R[rt]DRout,RinR#W#RegsLW指令执行数据通路lwrt,imm(rs)时序部件PCPCinPCout内总线操作控制信号…RinRoutR#W#Rs/RtRegDstRegs0
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