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cadence基础学习

教程实例：

DSP最小系统

教程内容：

1、利用CaptureCIS[原理图设计]进行原理图设计

2、利用CadencePCBEditor[PCB编辑器]布局布线

3、光绘文件（Artwork）制作，生成Gerber文件

1mil=0.0254mm

一原理图

放大I缩小O

图纸右下角标注：DesignTemplate[设计模板]

1、创建新工程文件库文件

2、参考datasheet在库文件中添加新元件：

Placepin（画管脚编辑属性，power型visible）、Placepin

array（管脚阵列）全部元件在Spreadsheet表中编辑（全选右键单击

editproperties）可以在新建元件时选NewPartCreation

Spreadsheet通过表格创建多引脚元件

常用选项：Option-partproperties/packageproperties[属性]

画不规则元件：Preference[优先权]中取消Pointersnapto

Grid[指针对齐网格]，随意划线，画完再改回去

3、分裂原件：homogeneous（完全相同）、heterogeneous

（多个功能模块不同）以NE5532为例

Tools-Annotate：给元件编号原理图中多个heterogeneous分

裂原件的分组问题：库文件中选中分裂原件，在partproperties中新

建newproperty（name如package不可为group，value为组号

123等），分裂原件的多个部分都要执行上一操作；打开原理图，双

击分裂原件在propertyeditor中将package属性设置为相同则为同

一组分裂原件；要给之编号还需在annotate[注释]菜单physical

packaging栏中将最后一项改为上文中name名

大型元件的分割：参考《cadence电路设计案例精析》P18

4、在工程中添加元件库（自建库、系统库）电容电阻电感变压在

discrete库中不知道元件在哪个库可以搜索

“放置元件”的意思是：placepart5、元件的连接：直接连、用

网络别名

连接（在同一原理图页面中placenetalias，名称相同表示电气

上连接在一起）引脚悬空（末端连Placenoconnect[没有连接的地

方]）

最好不要在放置元件时就把元件连在一起

6、总线：功能类似的信号

总线连接：Place-Bus默认直角拐弯

按住shift拉任意转方向画总线

命名netalias（规则：XX[起始：结束]）拖到总线上

连接管脚与总线：placebusentry、按F4连续放置总线入口、信

号线（与总线名一致）

总线之间的连接：T型交叉有电气连接十字无实际电气连接

不同页面之间的连接：placeoffconnect实际上与同一页

面连接时netalias相似

7、浏览BROWSE-元件parts（容易发现元件编号和大小错误）、

网络Nets（双击看某一网络与哪些部分连接）

页面之间进行互联的网络：Browse-offpageconnectors、电气

检查中的错误查看DRC

搜索Find元件parts、网络nets、Netlist

修改元件库后更新元件：replace/updatecache

工程已经不在的元件在cache中删掉cleanupcache

8、给元件添加封装信息：双击元件打开PropertyEditor，在

PCBFootprint中标注封装

批量修改封装：多选