数字电路时钟触发器的逻辑功能.pptVIP

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2025-09-02 发布于广东
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数字电路时钟触发器的逻辑功能.ppt

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第1页，共13页，星期日，2025年，2月5日一、SR触发器：CPRSCP=1期间，输出跟随输入状态的变化而变化,接收CP=0期间，SR不会影响输出端状态,保持1.功能真值表：第2页，共13页，星期日，2025年，2月5日动作特点:如果CP=1的期间内输入信号多次发生变化,则触发器的状态也会发生多次翻转,这就降低了电路的抗干扰能力.不定态，输出随输入而改变。第3页，共13页，星期日，2025年，2月5日2.激励表：10SR010XX0013.状态图：描述触发器的状态转换关系及转换条件的图形第4页，共13页，星期日，2025年，2月5日4.特性方程：就是触发器次态Qn+1与输入及现态Qn之间的逻辑关系式第5页，共13页，星期日，2025年，2月5日二、D触发器：CPD第6页，共13页，星期日，2025年，2月5日.状态图：D011100特点:无约束项即无不定态.第7页，共13页，星期日，2025年，2月5日三、JK触发器：在时钟信号作用下,符合功能表所规定的逻辑功能者,叫_____KJCP第8页，共13页，星期日，2025年，2月5日特点:无约束项即无不定态.第9页，共13页，星期日，2025年，2月5日状态图：JK011XX0X10X第10页，共13页，星期日，2025年，2月5日