数字逻辑设计及应用教学课件：73同步状态机分析.pptVIP

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2025-10-23 发布于北京
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数字逻辑设计及应用教学课件：73同步状态机分析.ppt

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Exerciseofclass如何变为D锁存器?SRCDCQQLS_LR_LQQLS_LR_L

Oflassclassreview

00011011SR维持011*Q功能表状态图01S=1,R=0S=0,R=1S=XR=0S=0R=X特征方程Q*=S+R’·QS·R=0（约束条件）S-RFlip-Flops(Latches)

00011011JK维持清0置1翻转Q*功能表特征方程Q*=J·Q’+K’·Q状态图01J=1,K=XJ=X,K=1J=XK=0J=0K=XJ-KFlip-Flop

状态图DFlip-Flops(Latches)特征方程：Q*=D01D=1D=0D=1D=0有使能端得D触发器：Q*=EN·D+EN’·Q

TFlip-Flop特征方程：Q*=Q’QQT有使能端的T触发器：Q*=EN·Q’+EN’·QENQTQ说明：传统中文教材中认为T触发器的特征方程为：Q*=T·Q’+T’·Q

SequentialLogicCircuitAnalysisandDesign

(时序逻辑电路的分析和设计)

SomestatemachineTheyallhaveclockgeneratorTheyallchangestateswhena‘tick’occurs.Theyallhavememories

7.3ClockedSynchronousState-MachineAnalysis

(时钟同步状态机的分析)(P542)“Statemachine”isagenericnamegiventothesesequentialcircuits;状态机:时序电路的通称.“clocked”referstothefactthattheirstorageelements(flipflops)employaclockinput;时钟:存储元件的时钟输入.“synchronous”meansthatalloftheflip-flopsusethesameclocksignal.同步:构成状态机的所有触发器都使用同一个时钟.

7.3.1State-MachineStructure

Nextstate=F(currentstate,input)Output=G(currentstate,input)CombinationallogiccircuitsThestatememoryisasetofnflip-flopsthatstorethecurrentstateofthemachine,andhas2ndistinctstates.

7.3.2OutputLogicAsequentialcircuitwhoseoutputdependsonbothstateandinputiscalledaMealymachine.Insomesequentialcircuits,theoutputdependsonthestatealone,SuchacircuitiscalledaMooremachine.

下一状态逻辑F状态存储器时钟输出逻辑G输入输出时钟信号激励当前状态下一状态逻辑F状态存储器时钟输出逻辑G输入输出时钟信号激励当前状态输出流水线存储器时钟Moore机：输出只与状态有关输出Mealy机：输出取决于状态和输入

7.3.3CharacteristicEquations

(特征方程)(P545)Q*(nextstate),Q(currentstate)

7.3.4AnalysisofStateMachineswithDFlip-Flops(P545)Theanalysisofaclockedsynchronousstatemachinehasthreebasicsteps:1.Determinethenext-stateandoutputfunctionsFandG.2.UseFandGtoconstructastate/outputtable(状态输出表