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【浮点乘法器的设计、综合与仿真探究案例4200字】.docx

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    浮点乘法器的设计、综合与仿真分析案例

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    浮点乘法器的设计、综合与仿真分析案例

    1.1浮点乘法器Verilog设计……

    1.2浮点乘法器逻辑综合………

    1.2浮点乘法器布局布线…………

    1.3浮点乘法器VCS仿真…………

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    1.1浮点乘法器Verilog设计

    如图3-4所示，通用的32位单精度浮点数由三个部分组成，可以表示为V=(-1)?*(1+0.M)*2E-127。

    S:1-bit符号域(sign),符号位为0即正，为1即负。

    E:8-bit指数域(exponent),表示2的指数，

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