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对工程文件进行编译、综合和适配等操作选择编译器编译窗第29页，共65页，星期日，2025年，2月5日完成编译！第30页，共65页，星期日，2025年，2月5日步骤5：时序仿真(1)建立波形文件首先选择此项，为仿真测试新建一个文件选择波形编辑器文件第31页，共65页，星期日，2025年，2月5日(2)输入信号节点从SNF文件中输入设计文件的信号节点点击“LIST”SNF文件中的信号节点第32页，共65页，星期日，2025年，2月5日（3）列出并选择需要观察的信号节点用此键选择左窗中需要的信号进入右窗最后点击“OK”第33页，共65页，星期日，2025年，2月5日图4-9列出并选择需要观察的信号节点(4)设置波形参量在Options菜单中消去网格对齐SnaptoGrid的选择(消去对勾)消去这里的勾，以便方便设置输入电平第34页，共65页，星期日，2025年，2月5日(5)设定仿真时间选择ENDTIME调整仿真时间区域。选择60微秒比较合适第35页，共65页，星期日，2025年，2月5日(6)加上输入信号为输入信号设定必要的测试电平或数据(7)波形文件存盘保存仿真波形文件用此键改变仿真区域坐标到合适位置。点击‘1’，使拖黑的电平为高电平第36页，共65页，星期日，2025年，2月5日(8)运行仿真器运行仿真器选择仿真器运行仿真器第37页，共65页，星期日，2025年，2月5日(9)观察分析半加器仿真波形半加器h_adder.gdf的仿真波形第38页，共65页，星期日，2025年，2月5日(10)为了精确测量半加器输入与输出波形间的延时量，可打开时序分析器打开延时时序分析窗选择时序分析器输入输出时间延迟第39页，共65页，星期日，2025年，2月5日步骤6：引脚锁定可选择键8作为半加器的输入“a”选择实验电路结构图6选择键7作为半加器的输入“b”可选择发光管8作为半加器的进位输出“co”可选择发光管7作为半加器的和输出“so”第40页，共65页，星期日，2025年，2月5日选择实验板上插有的目标器件目标器件引脚名和引脚号对照表键8的引脚名键8的引脚名对应的引脚号第41页，共65页，星期日，2025年，2月5日引脚对应情况实验板位置半加器信号通用目标器件引脚名EP1K30TC144引脚号1、键8：aPIO13272、键7bPIO12263、发光管8coPIO23394、发光管7soPIO2238第42页，共65页，星期日，2025年，2月5日选择引脚锁定选项引脚窗第43页，共65页，星期日，2025年，2月5日此处输入信号名此处输入引脚名按键“ADD”即可注意引脚属性错误引脚名将无正确属性！第44页，共65页，星期日，2025年，2月5日再编译一次，将引脚信息进去步骤7：编程下载(1)再编译1次将引脚信息编译进去第45页，共65页，星期日，2025年，2月5日选择编程器，准备将设计好的半加器文件下载到目器件中去编程窗(2)打开编程器窗口第46页，共65页，星期日，2025年，2月5日（3）设置编程下载方式在编程窗打开的情况下选择下载方式设置选择此项下载方式第47页，共65页，星期日，2025年，2月5日第1页，共65页，星期日，2025年，2月5日本章首先介绍MAX+plusⅡEDA开发工具软件的安装和操作指南，然后分别以原理图输入法和文本输入法为例详细介绍FPGA/CPLD的开发步骤和方法。EDA开发工具及技术第2页，共65页，星期日，2025年，2月5日1.MAX+plusⅡ的安装方法
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