CPLD大作业报告
——电子时钟设计
姓名:
班级:控制(
学号:
实验曰期:12月15曰
一、实验内容:
1.使用CPLD设计电子钟电路框图,并对重要功效进行解释;
2.设计小时、分、秒解决功效模块的VHDL程序;
二、实验规定:
1.编写小时、分、秒解决功效模块编程。
2.对仿真图形进行分析,对关键处的时序进行解释。
3.每个人的小时、分、秒数都不一样。依照任务布置,本设计的小时、分、秒数分别为24、32、32。
模块设计
1.一个模块实现的数字钟设计方案
(1)时钟VHDL源程序
LIBRARYieee;
USEieee
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