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芯片验证工程师笔试真题（含详细答案）

适用岗位：数字芯片验证工程师（应届生/初级工程师）

考试时长：90分钟满分：100分

说明：试题贴合国内IC设计公司真实笔试场景，侧重基础实操、项目常用知识点，无偏题怪题，适配校招、初级社招考核标准。

一、单项选择题（共10题，每题3分，共30分）

1.下列关于Verilog和SystemVerilog的区别，说法错误的是（）

A.SV支持类、继承、多态等面向对象特性，Verilog不支持

B.SV新增logic通用数据类型，可替代reg/wire，规避类型混用问题

C.Verilog可以直接使用rand随机约束，SV无需额外编译选项

D.SV支持断言、覆盖率收集、队列等高级功能，原生适配验证场景

2.UVM中，用于传递激励、数据、配置参数的核心组件是（）

A.uvm_driverB.uvm_sequence_itemC.uvm_monitorD.uvm_scoreboard

3.仿真中出现X态传播最不可能的原因是（）

A.变量未初始化B.双向端口未做上下拉约束C.时序逻辑时钟未稳定D.代码冗余注释过多

4.下列UVM组件中，属于动态创建、不固定层级的是（）

A.driverB.sequenceC.monitorD.agent

5.关于fork-join并行块