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众核结构下基于块的硬件调度器的创新设计与效能研究

一、引言

1.1研究背景与动机

1.1.1众核结构发展趋势

在计算机技术迅猛发展的当下，摩尔定律持续推动着芯片上晶体管数量呈指数级增长。在过去几十年间，芯片制造商不断提升芯片集成度，使得单位面积上能够容纳的晶体管数量不断增多。早期，单核处理器通过不断提高频率来增强计算性能，但随着物理极限的逐渐逼近，如功耗墙、散热等问题日益凸显，单纯提升频率已难以满足不断增长的计算需求。在这样的背景下，多核处理器应运而生，通过在单个芯片上集成多个相对简单的核心，并行处理多个任务，显著提高了计算性能。

然而，随着应用需求的进一步提升，特别是在大数据处理、人工