山东城市服务职业学院《数字逻辑电路（Ⅰ）》2023-2024学年第一学期期末试卷.docVIP

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山东城市服务职业学院《数字逻辑电路（Ⅰ）》

2023-2024学年第一学期期末试卷

题号

一

二

三

四

总分

得分

批阅人

一、单选题（本大题共15个小题，每小题1分，共15分．在每小题给出的四个选项中，只有一项是符合题目要求的．）

1、已知一个JK触发器的J=0，K=1，在时钟脉冲的下降沿到来时，触发器的输出状态会如何变化？（）

A.置1B.置0C.保持不变D.翻转

2、在数字逻辑中，复杂可编程逻辑器件（CPLD）和现场可编程门阵列（FPGA）是两种常见的可编程器件。以下关于CPLD和FPGA区别的描述中，不正确的是（）

A.CPLD基于乘积项结构，FPGA基于查找表结构

B.FPGA的逻辑资源比CPLD丰富

C.CPLD的编程速度比FPGA快

D.