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IC验证基础笔试试题（含详细答案解析）

考试说明：满分100分，考试时长90分钟，题型包含选择题、填空题、简答题、代码应用题，适用于应届生、初级IC验证工程师考核，侧重Verilog语法、UVM基础、验证流程、时序逻辑实操。

一、单项选择题（每题3分，共15分）

1.以下关于Verilog阻塞赋值（=）和非阻塞赋值（=）的说法，正确的是（）

A.时序逻辑电路推荐使用阻塞赋值

B.组合逻辑电路推荐使用非阻塞赋值

C.时序逻辑电路推荐使用非阻塞赋值，避免竞争冒险

D.两种赋值方式可随意混用，无电路差异

2.UVM验证平台中，负责产生激励、发送transaction的核心组件是（