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考试时间：______分钟总分：______分姓名：______

一、选择题（每题只有一个正确答案，请将正确选项的首字母填入括号内。每题2分，共20分）

1.下列哪个不是组合逻辑电路的特点？

(A)输出仅取决于当前输入状态

(B)输出状态有记忆性

(C)无反馈回路

(D)输出会随时间变化

2.在Verilog中，表示无符号整数的类型是？

(A)`reg`

(B)`wire`

(C)`int`

(D)`shortint`

3.以下哪个语句是Verilog中的阻塞赋值语句？

(A)`=`

(B)`assign`

(C)`=`

(D)`assign`

4.一个触发器（Flip-flop）在时钟边沿触发时，其次态主要取决于？

(A)时钟信号的电平

(B)输入信号的当前值

(C)输入信号的上升沿

(D)内部复位信号

5.在硬件设计流程中，逻辑综合（LogicSynthesis）的主要目的是将高级描述转换为？

(A)仿真波形图

(B)逻辑门级网表

(C)物理版图

(D)测试平台代码

6.HDL（硬件描述语言）主要用于