H.264视频解码器中帧内预测模块的硬件设计.PdfVIP

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集成电路应用 ’4456-,*627 28 97*/:+,*/3 ;6+-6*) !#$% 视频解码器中帧内预测模块的硬件设计 宋 健 王祖强 秦 盼 ! ! 山东大学 信息科学与工程学院 山东 济南 # ! 2HI4II ! 摘 要 提出一种能实时处理的 !1#$%’() 帧内预测硬件结构 通过对 !1#$%’() 各个预测模式 的分析 设计了一个通用运算单元 提高了硬件资源的可重用性 采用 个并行运算单元计算预测 ! ! % 值 对运算比较复杂的 模式预处理 并设计模式预测器 加快了系统处理速度 硬件电路结构已 ! 7=?9 ! ! 通过 级仿真及综合 并在 公司的 平台上进行了验证和测试 J+K ! ’=B98 )LA=?9 ** MNO’ ! # # # 关键词 !12$% 解码器 帧内预测 硬件 中图分类号! +P34315 文献标识码! ’ 文章编号! I2H5QR335S#I44T4IQIIHUQIU !’()’* (*+,-. /0 ,.1’ 2’*(,31,/. ,. !4$% 5,(*/ (*3/(*’ .?V W@? #X?V YDZ@?V #[@? N? !)==9V9 E *?E8;B@? .A@9?A9 ?: \?V@?998@?V #.]?:?V ,?@^98C@BL #W@?? 2HI4II #)]@? ’()*+,-* ! ’ ]8:_89 8A]@B9ABD89 E8 89=QB@;9 @;7=9;9?BB@? E @?B8 789:@AB@? @C 787C9:1 ’AA8:@?V B ?=L‘@?V == @?B8 789:@AB@? ;:9Ca B]@C 7798 :9C@V?C 78A9CC@?V 9=9;9?Ba B]9 78A9CC@?V 9=9;9?B @;78^9C B]9 89DCb@=@BL E ]8:_89 89CD8A9C1 *? 8:98 B @;78^9 B]9 78A9CC@?V C799:a ED8 78==9= 78A9CC@?V 9=9;9?BC 89 9;7=L9:a 7=?9 ;:9 789A;7DBB@? ?: ;:9 789:@A B8 89 :7B9:1 +]9 @?B8 789:@AB@? :9A:98 ]C 7CC J+K =9^9= 9;D=B@? ?: CL?B]9C@Cc @B ]C ^98@E@AB@? ?: B9CB ? ALA=?9 ** MNO’ 7=BE8;1 ./0 12+3) ! !12$% %:9A:98 %@?B8 789:@AB@? %]8:_89 !#$%’() 是由国际电信联盟!*+, 和国际标准化 分像素值和预测模式要进行存储#为后面宏块解码提供

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