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图9.1.1 PAC模块框图图9.1.2 仪表放大器PAC模块框图图9.1.3 PAC模块差分输出结构图9.1.4 PAC Designer中的有损积分模块图9.1.5可编程模拟器件的设计流程图9.2.1 ispPAC10内部结构框图图9.2.2 ispPAC10内部电路(a) (b)图9.2.3 ispPAC10中不同的使用形式图9.2.4 ispPAC20内部框图图9.2.5 ispPAC20内部电路图9.2.6 PAC20中的PAC块图9.2.7 ispPAC30内部结构和引脚图图9.2.8 ispPAC80内部结构及引脚图图9.2.9ispPAC 81内部结构及引脚图图9.3.1直流偶合偏置图9.3.2具有直流偏置的交流偶合输入图9.3.3 PAC块用作VREFout图9.4.1 PACblock结构示意图图9.4.2增益为4的PACblock配置图图9.4.3增益为20的PACblock配置图图9.4.4增益为40的PACblock配置图图9.4.5增益为40的另一种PACblock配置图图9.4.6增益为47的PACblock配置图图9.4.7增益为5.7的PACblock配置图图9.4.8整数比增益技术示意图图9.5.1PAC-Designer软件集成开发环境图9.5.2产生新文件的对话框图9.5.3图形设计输入环境图9.6.1 ispPAC80图形设计输入环境图9.6.2五阶滤波器库图9.6.3调入滤波器库后的ispPAC80图形设计输入环境图9.6.4 ispPAC80内部的五阶滤波器简化结构示意图图9.6.1方框图图9.6.2三运放组成的双二阶型滤波器图9.6.3用ispPAC10构成的双二阶滤波器图9.6.4用三运放组成的双二阶滤波器图9.6.5双二阶滤波器设计实例图9.6.6仿真参数设置对话框图9.6.7双二阶滤波器的仿真曲线
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