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中 北 大 学 信 息 商 务 学 院
毕业设计开题报告
学 生 姓 名: 学 号: 学 院、系: 电子与计算机科学技术 专 业: 电子科学与技术 设 计 题 目: HOTLINK 指导教师:
2010年 12月 10 毕 业 设 计 开 题 报 告
1.结合毕业设计课题情况,根据所查阅的文献资料,撰写2000字左右的文献综述: 文 献 综 述
HOTLINK的发展历史与趋势简述
Hotlink是由CYPRESS公司提出的高速串行传输的协议。协议中定义了物理层的内容,用户可以根据具体需要和情况自己定义数据链路层和应用层的协议,方便灵活。同时CYPRESS公司提供了实现Hotlink协议的成熟硬件,使用户可以集中精力进行数据传输的上层开发。Hotlink可以广泛应用于工作站、服务器、海量存储、图像和视频传输等方面[1]。对于想利用高速的点对点的串行通讯取代并行通讯接口以简化电路、降低成本的场合,Hotlink协议是一个理想的选择[2]。
HOTLink是Cypress公司的高速长距离点对点串行通信产品系列。符合DVB-ASI 、ATM 、SMPTE-259M、ESCON400Mbps,支持多种传输接口,如双绞线(最大距离可实现40m)、光纤(多模光纤可实现550m) [3],
具体工作原理是:在发送端将八位输入数据串行输出,接收端重新组合。发送端无有效数据时自动发送空数据,接收端根据码流自动恢复时钟。外部逻辑可以监视恢复时钟是否失同步, 一旦失同步即可控制接收端重新同步时钟, 而且HOTLink产品的一大特点是可以实现数据流与指令流的分离。
HOTLink的理论误码率为零,实际误码来自于内部时钟失同步以及外部环境电磁干扰[4]。
HOTLink 第二代产品可以支持1500Mbps 的传输速率,支持8位、16位、32位数据接口,性能大大提高。当然基于HOTLink设计通讯产品难度相对要大一些,应用HOTLink传输系统需要比较复杂的外部状态机的控制来保证接收端时钟正确恢复。而且由于系统时钟频率较高,PCB版图设计需要比较讲究, 要求设计者仔细考虑各种电磁干扰影响[5]。
HOTLink高速串行接口由HOTLink物理层收/发芯片、数据缓存和控制逻辑组成。作为一种传输系统,需要有效的编码,以提高系统数据传输性能,HOTLink物理层芯片采用8B/10B编码模式,即8位数据或专用字编码为10位传输码再逐位发送。编码后可使传输中0和l的数目均衡,接收时易于恢复发送时钟,增强检错能力,提高可靠性。收/发芯片能够自动校验接收到的串行数据,有效数据串/并转换为8-bit并行数据[6]。为了处理突发高速数据,一般采用FIFO作为物理层芯片与数据处理部分(本系统中为FPGA芯片)之间的数据缓存,选择合适大小的FIFO芯片与HOTLink收/发芯片组成无缝接口。
1.2 FPGA的原理及其发展
FPGA是英文Field-Programmable Gate Array的缩写,即现场可编程门阵列,它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的缺点
FPGA/CPLD芯片都是特殊的ASIC芯片,它们除了具有ASIC的特点之外,还具有以下几个优点:
·随着VLSI(Very Large Scale IC,超大规模集成电路)工艺的不断提高单一芯片内部可以容纳上百万个晶体管FPGA/CPLD芯片的规模也越来越大,其单片逻辑门数已达到上百万门,它所能实现的功能也越来越强,同时也可以实现系统集成。
·SRAM,便于实现在系统动态重构(ICR),但芯片掉电后,配置信息丢失,需另设非易失性存储器件保存配置信息并完成上电自动加载[9]。
可以说,FPGA芯片是小批量系统提高系统集成度、可靠性的最佳选择之一。
FPGA是由存放在片内RAM中的程序来设置其工作状态的,因此,工作时需要对片内的RAM进行编程。用户可以根据不同的配置模式,采用不同的编程方式。
加电时,FPGA芯片将EPROM中数据读入片内编程RAM中,配置完成后,FPGA进入工作状态。掉电后,FPGA恢复成白片,内部逻辑关系消失,因此,FPGA能够反复使用。FPGA的编程无须专用的FPGA编程器,只须用通用的EPROM、PROM编程器即可。当需要修改FPGA功能时,只需换一片EPROM即可。这样,同一片FPGA,不同的编程数据,可以产生不同的电路功能。因此,FPGA的使用非常灵活。
FPGA(Field Programmable Gate Arra
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