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指导老师：王翠兰
姓 名 ：周云飞
学 号：2003110303008
班 级：03级电子信息 3班
日 期：2005年 10 月 24 日
漯河职院机电系03电子信息专业毕业设计
目 录
目录……………………………………………………………………1
一、功能及原理简介…………………………………………………2
二、设计概述…………………………………………………………3
2.1设计题目 ……………………………………………………… 3
2.2设计要求…………………………………………………………3
2.3功能特性…………………………………………………………3
2.4设计原理…………………………………………………………3
三、分电路设计及步骤………………………………………………4
3.1振荡器电路的设计 …………………………………………… 4
3.2分频器的设计……………………………………………………7
3.3时、分、秒计数器电路的设计……………………………………8
3.4译码器及显示电路的设计 ……………………………………10
3.5校时电路的设计 ………………………………………………11
3.6整点报时电路的设计 …………………………………………12
3.7总体电路图 ……………………………………………………14
四、元器件清单及说明………………………………………………15
4.1元器件清单列表 ………………………………………………15
4.2相关元器件说明(补充资料) …………………………………15
五、设计体会…………………………………………………………22
附 录…………………………………………………………………24
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漯河职院机电系03电子信息专业毕业设计
一、功能及原理简介
数字钟是一个将“ 时”、“分”、“秒”显示于人的视觉器
官的计时装置。它的计时周期为 24 小时，显示满刻度为 23 时 59
分 59 秒，另外应有校时功能和报时功能。因此，一个基本的数字
钟电路主要由振荡器、分频器、计数器、译码器、显示器、校时电
路和报时电路组成，振荡器产生的信号经过分频器作为秒脉冲，秒
脉冲送入计数器计数，计数结果通过“时”、“分”、“秒”译码
器显示时间。
系统的精度，一般用振荡器加分频器来实现。将标准秒信号送
入“秒计数器”，“秒计数器”采用60进制计数器，每累计60秒发
出一个“分脉冲”信号，该信号将作为“分计数器”的时钟脉冲；
“分计数器”也采用60进制计数器，每累计60分钟，发出一个“时
脉冲”信号，该信号将被送到“时计数器”；“时计数器”采用24
进制计时器，可实现对一天24小时的累计。译码显示电路
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