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数字电子技术期中试卷.docVIP

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数字电子技术期中试卷

武汉大学电气工程学院 《数子电子技术基础》 试卷 姓名 学号 成绩 一、选择题(每空2分,共20分)2. 的反函数为 B. C. D. 3. 一个4位移位寄存器可以构成最长计数器的长度是( ) A.8 B.12 C.15 D.16 4. 满足特征方程的触发器成为’触发器 D.RS触发器 5. 对CMOS与非门电路,其多余输入端正确的处理方法是( ) A.通过大电阻接地() B.悬空 C.通过小电阻接地() D.通过电阻接 6. 以下各电路中,( )可以产生脉冲定时 A.多谐振荡器 B.施密特触发器 C.单稳态触发器 D.石英晶体多谐振荡器 7. 引起组合电路中竞争与冒险的原因是( ) A.逻辑关系错 B.电路延时 C.干扰信号 D.电源不稳定 8. 十进制数25用8421BCD码表示为( ) A.10101 B C.100101 D.0010101 9. 为实现将JK触发器转换为D触发器,应使( ) A.J=D, B.K=D,J=1 C.J=K=D D.J=K=1 10. 用二进制码表示指定离散电平的过程称为( ) A.采样 B.量化 C.保持 D.编码 二、填空题(每空1分,共10分) 1. 一般A/D转换过程要经过__________、__________、__________、__________四个步骤。 2. 2的十六进制数值为__________,八进制数值为__________。 3. 555构成的施密特触发器,若为15V,则上门限电压为 2. 图形法化简逻辑函数 四、分析题(2×10分) 1. 逻辑电路如下图所示,试写出逻辑式,列出真值表,分析逻辑功能。 2. 下降沿触发的边沿JK触发器的输入CP、J、K端的波形如下图所示,试画出端Q的波形。设触发器的初始状态为Q=0。 五、设计题(2×20分) 1. 用两片74LS161二进制计数器构成40进制计数器,画出电路图。74LS161为同步16进制计数器,它的逻辑图如下。 2. 某产品有A、B、C、D四项质量指标。规定:A必须满足要求,其它三项只要有任意两项满足要求,产品就算合格。试设计一个检验产品是否合格的逻辑电路,用与非实现。

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