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2015-09-25 发布于重庆
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buffermanager的详细设计

亚芯微电子有限公司 ASIAN MICROELECTRONICS CO.LTD AM0202 项目 Buffer Manager 的详细设计 From：周云明（2003-7-28）文档编号：（个人不填）在 RSPC 解码中，对于乘积部分的处理是有先后的，所以处理完行之后要把数据存起来，再处理列。这就需要一个很大的空间来存放这些数据，一个 RSPC 块的大小是 37856 个数据。我们采用外接 SDRAM 的形式来实现。由于 SDRAM 是一维访问的，所以普通的访问方式不适合我们的RSPC 数据的读写。所以要在存放和读出时作一些处理。这里采用的方式是地址映射。这部分是由以下几个部分组成的：输入 FIFO，输出 FIFO，buf_manager， sdr_ctrl，col_signal。输入 FIFO 的功能是使数据由RSPC 时钟区输入到Dram 时钟区。输出 FIFO 是使数据由 Dram 时钟区输出到 RSPC 时钟区。大小是：64×9。 buf_manager：完成的是 DRAM 的数据总线仲裁，地址产生，读写控制等功能。 sdr_ctrl：根据 buf_manager 的读写控制信号，完成对外接 DRAM 的访问，还包括了 DRAM 的自动刷新功能。 Din Data Flow O F Control I F k Dram read 入 c o Din 写 l B valid Arbiter Dram write r e g a Do Dram write n a Dout M Address Dout r Generator Do Dram read O e Dout column F f I f valid signal F u Do refresh 出 B Dout Dout 读 Data Path sync. valid Control 图 1 Buffer Manager 及其接口模块为达到一个较高的 DRAM