2选1多路选择器的VHDL描述芙.docVIP

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2016-09-23 发布于湖北
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XXXXX大学实验报告课程名称：EDA技术试验实验名称：2选1多路选择器的VHDL描述学号：姓名：指导教师评定：______________________ 签名：_____________________________ 实验目的 1、学习2选1多路选择器的设计; 实验仪器:计算机,Quartus 2软件实验步骤: 新建一个文件夹,打开Quartus 2软件,选择FILE-NEW菜单,在弹出的NEW对话框中选择DEVICE DESGIN FILE页的原理图文件编辑器输入项VHDL FILE,按确定键打开VHDL编辑器窗口;在VHDL编辑器窗口输入2选1多路选择器的VHDL描述; ENTITY mux21a IS:IN BIT; y:OUT BIT); END ENTITY mux21a; ARCHITECTURE one OF mux21a IS BEGIN y=a WHEN s=’0’ ELSE b; END ARCHITECTURE one; 或者： ENTITY mux21a IS PORT(a,b:IN BIT; s:IN BIT; y:OUT BIT); END ENTITY mux21a; ARCHITECTURE one OF mux21a IS BEGIN y=a WHEN s=’0’ ELSE b; END ARCHITECTURE one; 打开波形编辑器,分别运行2选1多路选择器,观察他们的输出波形 ; 4、调出VHDL描述产生的2选1多路选择器的原理图.点击TOOLS-NELIST VIEWERS-RTL VIEWERS,即调出VHDL描述产生的2选1多路选择器的RTL电路图,如所示: 实验小结经过本次试验初步了解了Quartus 2软件