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* * 在线教务辅导网: 教材其余课件及动画素材请查阅在线教务辅导网 QQ:349134187 或者直接输入下面地址: 《微机原理及其应用》 第6章I/O系统 机械工业出版社 电子制作:李益敏 6.1 I/O接口概述 6.2 接口数据的传送方式 6.3 DMA控制器8237A 目录 第6章 I/O系统 6.1 输入/输出接口概述 6.1.1 接口的概念与功能 输入输出(以下简称I/O)系统是计算机系统的重要组成部分之一,它包含I/O设备(简称外设)以及它们与计算机之间的接口。 I/O接口一般具有以下基本功能: 1.数据缓冲 2.执行CPU命令 3.设备选择 4.信号转换与数据格式转换 注意:前三项功能是一般接口都需要的。 第6章 I/O系统 6.1.2 接口信号的分类及基本结构 1.接口的信号分类 (1)数据信息 (2)状态信息 (3)控制信息 2.接口的基本结构 第6章 I/O系统 CPU 数据总线 I/O接口 数据端口 状态端口 控制端口 地址总线 控制总线 数据线 状态线 控制线 I/O 设备 译码 图6-1 接口的基本结构 第6章 I/O系统 6.1.3 端口地址及编址方式 1.端口地址 2.两种编址方式 (1)I/O接口与存储器统一编址 (2)I/O接口独立编址 6.2 接口数据的传送方式 6.2.1 无条件传送方式 这种方式下,CPU不查询外设状态,在其需要时直接对外设执行I/O操作。此方式优点是硬件和软件都达到最简单,缺点是外设必须随时处于待命状态,并且外设的处理速度必须跟上CPU的速度,否则就会出错。所以无条件传送用的较少。图6-2所示。 第6章 I/O系统 地址 译码 输出 锁存器 三态 缓冲器 EN & & 数据总线 地址总线 M/IO WR 输出设备 输入设备 RD 图6-2 无条件输入输出传送方式 第6章 I/O系统 6.2.2 查询传送方式 采用这种方式,CPU在进行输入/输出前,先检查外设提供的READY(准备好)信号是否有效,若有效,表示外设可以接受操作,CPU即进行输入/输出操作;若无效,表示外设暂不能接受操作,CPU则等待。在等待期间,CPU所做的只是循环检测READY信号,一旦发现其变为有效,就立即进行操作。 第6章 I/O系统 查询式输入 图6-3是一个用查询输入的接口电 路。 其工作过程如下: RD 地址总线 三态 缓冲器 (8) 三态 缓冲器 (1) 锁 存 器 R Q D 地址 译码 输入装置 & & 状态 端口 数据 端口 +5V M/IO M/IO 选通 数据 READY 图6-3 查询式输入接口电路 RD 第6章 I/O系统 2.查询式输出 图6-4为一个用查询式输出的接口电路。 其工作过程如下: 锁 存 器 Q R D 输出装置 三态 缓冲器 (1) 地址 译码 & & 数据 ACK STB WR M/IO 数据端口 状态端口 去数据总线 D7 BUSY +5V M/IO RD 地址总线 AB 数据总线 DB 图6-4 查询式输出接口电路 第6章 I/O系统 6.2.3 中断传送方式 查询方式进行数据传送解决了CPU与外设速度的协调问题,但大大降低了CPU的使用效率,因为CPU把大部分时间都花费在查询外设状态上,在查询期间CPU不能从事其他工作。 6.2.4 DMA传送方式 CPU DMA 控制器 外设 接口 BUS 内存 HOLD HLDA DREQ DACK 控制信号 图6-5 DMA传送方式示意图 第6章 I/O系统 DMA传送的基本过程: (1)外设提出DMA传送请求。当外设需要输入或输出数据时,向DMA控制器发出DMA请求信号DREQ,表示请求进行一次DMA传送。 (2)DMA控制器向CPU发出总线保持请求。DMA控制器接到请求后,经控制电路向CPU的HOLD引脚发出总线保持请求,请求取得总线控制权,并等待CPU的回答。 第6章 I/O系统 (3)CPU响应。CPU在每个时钟上升沿都监测有无HOLD请求,若有此请求,且自身正处在总线控制周期中,CPU就立即响应此总线保持请求。如果CPU正在执行某个总线周期,那么要到这个总线周期结束后再响应此总线保持请求。CPU对总线保持请求有两个动作:一是
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