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EDA论文 题 目 基于Verilog的数字钟设计 学 院 通信与电子工程学院 专业班级 通信017班 学生姓名 大彬哥 指导教师 大力会 2013年月 日 摘要关键词：Abstract The design for a multi-functional digital clock, with a year, month, day, hours, minutes and seconds count display to a 24-hour cycle count; have proof functions and the whole point timekeeping function.The use of EDA design technology, hardware-description language VHDL description logic means for the system design documents, in MaxplusII tools environm